AMD第二代Versal AI Edge和Prime系列:嵌入式系统单芯片智能新突破
作者:Ryan Koehn AMD Versal 自适应 SoC 高级产品线经理 去年,我们推出了 AMD 第二代 Versal AI Edge 系列和第二代 Ve
关于「嵌入式与微控制器系统」的技术文章、设计资料与工程师讨论,持续更新。
作者:Ryan Koehn AMD Versal 自适应 SoC 高级产品线经理 去年,我们推出了 AMD 第二代 Versal AI Edge 系列和第二代 Ve
“在本文中,我将向大家展示一个结合了树莓派Pico (RP2040) 与 Cyclone 10 FPGA 的PCB设计项目。我将解释项目中的一些设计决策
引言:本文介绍FPGA与高速ADC接口方式和标准以及JESD204与FPGA高速串行接口。 1. 高速ADC与处理器互联需要权衡的因素 如图1所示,ADC模数转换器
实现将SC130GS采集的黑白图像数据缓存进DDR3,并以1024*600@60的视频时序输出到LVDS 屏幕显示。其中,DDR3工作频率为600MHz,SC130GS输
引言:本文以TI的ADS4249(ADC)和DAC3482(DAC)之间的接口为例,介绍Altera FPGA与ADC/DAC之间的DDR LVDS接口设计以及时序约束详细
No.1引言 随着现代电子系统的不断发展,时钟管理成为影响系统性能、稳定性和电磁兼容性(EMI)的关键因素之一。在FPGA设计中,PLL因其高精度、灵活性和可编程性而得
AI 正在向边缘迁移 从聊天机器人、内容生成到高级数据分析,AI 已无处不在。过去,大多数 AI 处理都在云端完成。然而,随着模型功能日益强大以及对实时洞察的需求持续增
电子发烧友网报道(文/黄晶晶)赛灵思(Xilinx)推出的第一款FPGA芯片XC2064于1985年6月问世,它有600个门,64个可配置逻辑块,运行频率为70MHz。这款
概念 传感器输出经过标定的数字信号输出,通过标准的I2C接口传输数据; 相对湿度的分辨率在0.024%RH,工作范围为0~100%RH; 温度值的分辨率在0.0
01Veloce proFPGA Veloce proFPGA 平台提供三类主板:Uno、Duo 和 Quad。这些主板支持轻松插入和混用不同类型的现场可编程门阵列 (
PIO IP是FPGA 设计中比较简单常用的IP, 当设置PIO IP的Direction的时候,可以看到有如下4个选项: Input代表这组IO是输入引脚,O
本文作者:AMD 工程师 Sandy Macnamara 本文讲述了AMD UltraScale /UltraScale+ FPGA 原生模式下,异步模式与同步模式的对
借助Verilog,在FPGA中实现了带编码器的两台电机的电机控制系统的RTL级设计。 介绍 借助硬件描述语言 (HDL) Verilog 和 AMD Viv
引言 今天继续常春藤名校之一——康奈尔大学的FPGA课程ECE 5760典型案例分享:基于DE1-SOC开发板的Chirikov标准映射求解器。 1. 项目概述
2025年7月1日至3日,欧洲 FPGA大会在德国慕尼黑盛大举行。作为FPGA领域的年度盛会,此次大会吸引了来自全球各地的企业、专家与学者,共同探讨FPGA技术的前沿趋势与应用
第一部分 设计概述 /Design Introduction 1.1设计目的 本设计中,计划实现对文件的压缩及解压,同时优化压缩中所涉及的信号处理和计算密集型
第一部分 设计概述 /Design Introduction 1.1设计目的与应用 随着人工智能的发展,神经网络正被逐步应用于智能安防、自动驾驶、医疗等各行各
第一部分 设计概述 自适应滤波是近几十年发展起来的信号处理理论的的新分支。随着人们在该领域研究的不断深入,自适应处理的理论和技术日趋完善,其应用领域也越来越广泛。自适
如何为您的应用选择更理想的 DRAM? 对于嵌入式系统工程师而言,选择合适的 DRAM 至关重要,需综合考虑带宽、时延与功耗限制。在近期发布的白皮书中,我们详细比较了主
TJ375已经支持PLL的动态配置。打开PLL在Advance Settings中的Dynamic Reconfiguration中勾选Enable就可以了。最大可以支持8