博通助力 CPU 与 XPU 厂商迈向计算架构垂直堆叠
为降低芯片组件间延迟，同时在单封装内为计算引擎及网络专用集成电路集成更多电路，芯片设计厂商跳出二维平面架构、开启元器件垂直堆叠已是大势所趋。 高带宽内存（HBM）堆叠已率先实现 DRAM 内存的垂直化。相较于负责数据传输与运算的专用芯片，内存芯片功耗更低，因此 HBM 堆叠的实现难度相对更低。业界现已采用 2.5D 堆叠技术，通过中介层将 GPU、XPU 等计算芯片与 HBM 堆叠内存互连；AMD
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封装载板制造特殊工艺——Coreless 无芯工艺与 ETS 埋线路工艺
本文主要讲述封装载板制造特殊工艺。 在行业通用的载板制造领域中，除了减成法（Tenting）、改良型半加成法（mSAP）、半加成法（SAP）这三种主流核心技术路线外，还包含无芯工艺（Coreless）、嵌入式线路工艺（ETS，即 Embedded Trace Substrate/Embedded Pattern Process）、无芯铜柱法工艺（Via Post Coreless）等特殊工艺。 这