Verilog是怎么一点一点写出来的！
一、标识符与注释 前面已经说到，模块名的定义要符合标识符的定义，那么什么是标识符呢？它的语法是什么呢？ ①标识符是赋给对象的唯一名称，通过标识符可以提及相应的对象，Verilog语法将对转义标识符中的字符逐个处理。 ②标识符可以是字母、数字、下划线和美元符$的组合，并且标识符的第一个字母必须是字母或者是下划线。此外，在Verilog的标识符中，是区分大小写的。 ③Verilog中有一些关键字，简
技术文章
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蓝牙基础(八)：蓝牙应用、Profile、协议栈
前言 前面我们介绍的蓝牙核心系统架构、信道、跳频选择算法、状态、角色、地址可靠性和数据处理流程这些，都是比较偏底层的一些知识。 底层协议规范的制定、开发、验证是一项复杂的任务，首先是 要传输比特，然后是数据包，这些数据包可能还需要重复传输。 数据包构成通信流的一部分，通信流可以进行复用和路由。通信流又可以使用不同的封装方式传输不同类型的信息，等等。 底层部分一般都是芯片原厂或是操作系统已经做好了封
用Python给Verilog设计自仿（11）：协程、阻塞勘误及AXIS开源验证剖析
前言 在上一篇文章中，我们提到相同协程是阻塞的，不同协程是并发的这一说法。然而，这种理解存在偏差，所以第一个现象并不像我们之前想象的那样。今天，我们将专门梳理协程的概念，深入剖析其本质，以纠正上次关于协程与阻塞的说明。 案例说明 下面我将介绍一种非常典型的现象 for i in range(2): await device_to_host_source.send(frame) for
ZYNQ PS与PL 数据交互方式（总结）
ZYNQ SoC 的 PS (Processing System) 和 PL (Programmable Logic) 之间的数据交互是系统设计的核心，以下是主要的交互方式及其特点： 一、AXI 总线接口 1. AXI4 高性能接口 AXI4 (AXI4-Full) 用于高性能内存映射通信 支持突发传输，数据位宽通常为32/64/128/256/512位 典型应用：大数据量传输，如视频流、DMA传
陈老湿·OFDM合集第二版分享
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单向晶闸管的结构与导电特性
晶闸管（Thyristor）是晶体闸流管的简称，又被称做可控硅整流器，以前被简称为可控硅；1957年美国通用电气公司开发出世界上第一款晶闸管产品，并于1958年将其商业化。 晶闸管是NPNP四层半导体结构，它有三个极：阳极，阴极和控制极；晶闸管具有硅整流器件的特性，能在高电压、大电流条件下工作，且其工作过程可以控制、被广泛应用于可控整流、交流调压、无触点电子开关、逆变及变频等电子电路中。 晶闸管
【开源资料】Sming：让嵌入式开发更简单的异步 C++ 框架
Sming 是一款具备卓越性能且集成丰富网络功能的异步嵌入式 C++ 框架。该框架为开源项目，采用模块化设计，支持多种硬件架构，包括 ESP8266、ESP32 以及树莓派 Pico（涵盖 RP2040 和 RP2350 两个版本）。 源代码文件 文件结构说明 此开源资料可以查看底部源文件链接了解详情 如何下载资料 不会获取的同学，看一下下方获取资料视频教程。
Coherent在OFC 2026：光通信行业的拐点时刻
今年三月的洛杉矶，OFC 大会再次刷新了规模纪录。走在展厅里，你能明显感受到一种兴奋的氛围——光通信技术正在从幕后走向台前，成为 AI 数据中心架构中不可或缺的核心要素。 Coherent 的 CEO Jim Anderson 在会上开门见山地说了一句话：“我觉得现在可能是光通信行业有史以来最好的时候。”这不是客套话，从他们展示的技术路线图和产品时间表来看，这家公司确实站在了一个关键的转折点上。
【W42周报】六层PCB板是怎么拼出来的？
1.前言 求职面试时,大多数人都会在一个问题上纠结：去大公司还是小公司？这个问题在现阶段其实没有人能够给出一个100%完美的答案。如果展开来说，估计也要花好长时间。无论去哪个公司，落到我们自身来说，主要还是要能在岗位上体现出个人的价值。即用专业能力、综合素质能力去解决工作中的问题。 解决问题的快慢程度和结果好坏，就和我们掌握的专业技能和方法论有关。比如在我们公司，PCB板的Layout不需要硬件工
ISE14.7兼容性问题集锦
一、 **关于win8和win10不兼容性解决办法** （win7不会出现闪退的问题，按安装流程做完就可以直接使用了） 在安装目录下，我这里是D:\ISE_14.7\14.7\ISE_DS\ISE\lib\nt64中找到libPortability.dll和libPortabilityNOSH.dll两个文件夹，其中将原来的libPortability.dll重名为libPortability_
锁相环设计（二）
锁相环的基本原理 本章主要介绍锁相环的基本原理，主要介绍电荷泵锁相环的基本原理以及连续线性模型分析方法，在连续线性模型分析的基础上分析环路的稳定性，最后给出环路滤波器的参数的计算公式。 其中整个锁相环系统是一个相位负反馈系统，主要由鉴频鉴相器、电荷泵、环路滤波器、压控振荡器、分频器等模块组成。将分频器反馈的信号和参考时钟信号进行比较当两者的相位差为0时，环路进入稳定状态。对于锁相环在原点的个数对
芯片输入口的二极管钳位电路什么原理？
大家好，我是记得诚。 图1蓝色框内是二极管钳位电路的一般结构，多见于芯片输入端。当然还有专门的开关二极管，如下图2红色框内所示。本文主要针对此类型的二极管电路做一些简单介绍。 图1：mcu内部IO结构处的保护二极管 图2：常见的几种开关二极管 电路作用：实现二极管对异常电压的钳位作用，保护后级输入。 实现原理：下图3是用LTspice进行仿真的图形，D1和D2是肖特基二极管，正向导通压降Vf
Cadence里的版图放到ADS里面联合仿真的设置
以前领导给我打电话，说他们做的板子性能达不到预期，怀疑是板上线宽的问题。 虽然我觉得1GHz这个频率，板子的影响应该不至于这么大，但是万一呢？于是，我对领导说，那把PCB发给我，我来仿真一下吧，看看PCB上的线宽是不是有影响。 本来想，就用最原始的方法，把PCB的TOP层和孔的一些信息导出到dxf，然后稍微手工删减一下，再导入ADS，设置个两层板的叠层结构，一仿真，不就完事了。 哪想，拿到PCB以
自己画一块ESP32-C3 的开发板（第一次使用立创EDA）（PCB到手）
记录一下第一次使用立创EDA第一次设计ESP-C3的开发板 by 矜辰所致 @TOC 用了安信可的ESP32-C3的开发板，跑通了第一个程序。后面测试一些其他功能发现连接串口助手的时候经常一连接就进入程序下载模式，程序都不能正常运行很烦： 在这里插入图片描述 所以自己决定自己画一个开发板。原理图当然还是参考乐鑫的官方文件《ESP32-C3系列芯片硬件设计指南》，但是外设部分还是根据
AI Infra 基础知识 - NVLink 入门
NVLink是一种专有系统互连硬件，可促进多个 Nvidia GPU 和支持CPU之间的一致数据和控制传输。 概述 NVLink 于 2014 年初发布，旨在作为 PCI Express 的替代解决方案，具有更高的带宽和附加功能（例如共享内存），专门设计用于与 Nvidia 自己的多 GPU 系统的 GPU ISA 兼容。在推出 NVLink 和 Pascal（例如Kepler）之
恒虚警检测算法-CFAR
统计检测理论是利用信号的统计特性和噪声的统计特性等信息来建立最佳判决的数学理论，也就是要解决在受噪声干扰的观测中，信号有无的判决问题。由于噪声的存在及观察样本数或样本长度的限制，在检测过程中，不可避免地会产生判决错误。 那么怎样尽可能地减少这些错误呢？错误一般分为两种，一种是漏报，一种是虚警，在不同的工作情况下，这两种错误所造成的后果并不一样，从而引入了最佳准则问题。不同的准则下有不同的判决规则（
秒懂 Linux time 命令：性能调优必备技能！
   链接： 有时您可能希望根据以下参数分析您的程序：程序在用户模式下花费的时间内核模式下程序花费的时间程序的平均内存使用量ETC在 Linux 上
curl使用读回调来分块上报文件
关注“码农爱学习”，设置“星标公众号” 之前的文章《curl编程实例-上传文件》，介绍过如何使用curl编程来上传文件，是通过指定文件路径的方式来上传，关键的特征如下： const char *file_path = "./test.txt"; // 要上传的本地文件 // 打开待上传的文件（二进制模式） FILE *fp = fopen(file_path, "rb"); curl_ea
彻底理解C++中的适配器模式！
你是一名C++大牛，正在开发公司的核心业务系统，这个系统里有一套统一的日志接口： class ILogger { public: virtual void log(const std::string& message) = 0; virtual void error(const std::string& message) = 0; }; 所有模块都依赖这个接口，文件
用数电真值表的方式看嵌入式按键扫描
按键在嵌入式单板中几乎是必不可少的，可见其非常之重要，那么今天我们就来讲一下关于按键扫描的内容。 先讲一下按键抖动的内容吧，现在的单板系统中按键基本上都是机械式按键，那么机械式按键就存在抖动的问题，图1表示一个按键由按下到弹起的过程，理想波形是假设按键不存在抖动的状态，可以看到按键按下和弹起的界限是非常明显的，然而实际上机械按键都是有抖动的，也就如实际波形显示的那样，在按下和弹起的这段时间，按键存