芯片输入口的二极管钳位电路什么原理？
大家好，我是记得诚。 图1蓝色框内是二极管钳位电路的一般结构，多见于芯片输入端。当然还有专门的开关二极管，如下图2红色框内所示。本文主要针对此类型的二极管电路做一些简单介绍。 图1：mcu内部IO结构处的保护二极管 图2：常见的几种开关二极管 电路作用：实现二极管对异常电压的钳位作用，保护后级输入。 实现原理：下图3是用LTspice进行仿真的图形，D1和D2是肖特基二极管，正向导通压降Vf
技术应用
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万能头文件 bits/stdc++.h应该使用吗？
bits/stdc++.h 是一个在 C++ 编程中常用的头文件，主要用于简化代码的编写。它包含了几乎所有的标准库头文件，方便程序员在编写代码时不必逐一包含每个头文件。 该头文件的所在源码仓库 https://gist.github.com/Einstrasse/ac0fe7d7450621a39364ed3b05cacd11 用法 在 C++ 程序中，使用 bits/stdc++.h 的方式非常
用Python给Verilog设计自仿（11）：仿真的玄学问题——协程、阻塞、 事件驱动、时间驱动
前言 在使用 cocotb 编写测试时，很多人可能都会遇到一些让人困惑的现象：比如说，你明明在发送一帧完整数据之后，加了 await RisingEdge(clk) 想等待 5 个周期再发下一帧，但在波形上却发现帧与帧之间并没有间隔；或者你在别的地方加了 Timer 也没起作用更甚至cocotb直接卡住不动了；又或者明明指定了发包数，却提前结束了。 这些现象的背后，其实不是 cocotb 出了问题
fpga实现音频预加重（pre-emphasis）滤波器
1预加重滤波器的作用 在语音信号中，声门波激励和口鼻辐射效应共同导致语音信号的高频分量能量要比低频分量弱。预加重（Pre-emphasis）的目的就是：1 .提升高频分量，平衡语音频谱，使得高频特征更加明显，便于后续的特征提取（如MFCC）。2.消除发声过程中口唇辐射的影响。3.在一定程度上抑制工频干扰。 2 预加重滤波器的使用场景 语音识别前端处理作用：这是预加重最经典和最重要的应用。平衡频
电磁炉你肯定用过，但是各电路原理你了解吗？
电磁炉，这一现代厨房中的烹饪新星，凭借其独特的优势，日益受到人们的青睐。其便捷性和高效性，使得它成为忙碌现代人理想的选择。了解电磁炉在现代厨房中的角色，更是开启美食烹饪之旅的关键第一步。 电磁炉的主要电路包括以下几个部分： 1、电磁炉开机保护电路 电磁炉开机保护电路的作用是保证电磁炉在待机状态下IGBT不工作，防止电磁炉一开机（未按加热键）就加热的现象出现。该电路主要由主控IC（局部）、晶体管
怎么检查PCB走线？布局？可制造性？一款免费避坑神器
公众号后台回复：DFM 对于硬件工程师而言，最紧张的时间节点就是发板前夕，画好的PCB要出Gerber文件给工厂，这Gerber文件是一定要仔仔细细检查，以前我一直用CAM350，这种检查纯靠“眼力”，简单的板子还好，遇到复杂的板子，纯靠肉眼检查的话，难免有遗漏，以至于每次发板，总是提心掉胆，尤其是第一版硬件。 今天推荐一款比CAM350还好用的软件，电子发烧友论坛出品的《华秋DFM》，支持Al
如何学习FPGA（转）
一、入门首先要掌握**HDL（HDL=verilog+VHDL**）。 第一句话是：还没学数电的先学数电。然后你可以选择verilog或者VHDL，有C语言基础的，建议选择VHDL。因为verilog太像C了，很容易混淆，最后你会发现，你花了大量时间去区分这两种语言，而不是在学习如何使用它。当然，你思维能转得过来，也可以选verilog，毕竟在国内verilog用得比较多。
【Cadence】psp or hbsp仿真设置
1.算法简介 在Cadence SpectrePF 里 ，psp 即 pss+sp，hbsp 即 hb+sp, 二者都是可以仿真含谐波或周期信号的S参数。与sp的区别在于，psp和hbsp仿真的是大信号S参数，sp仿真得到的是小信号S参数 psp 和 hbsp的设置基本一致，得到的结果也接近，最好不要一起跑（笔者一起跑得到的结果有误）。下面以psp为例进行说明。 2.端口设置 在端口设置上，与s
模拟芯视界 | 分立式与集成式差分放大器对比
引言 利用运算放大器（运放）和电阻器网络，可以构建多种实用电路，差分放大器 (DA) 便是其中之一。借助 DA，可以测量两个信号之间的差值，这对于太阳能电池板、移动电源和其他 DC/DC 模块等系统中的电流和电压检测非常有用。此外，许多 DA 可以施加增益，向信号添加基准电压，以及抑制输入信号产生的共模噪声。 DA 主要有两种类型：分立式（使用外部电阻器）和集成式（使用单片或片上电阻器）。本文将通
MOS管设计防反接电路（收藏）
电子元件大都是使用直流工作，电源线反接就有可能就会烧坏，那电路如何防反接？ 首当其冲我们想到的就是二极管了，运用其单向导通特性可有效防止电源反接而损坏电路，但是随之而来的问题是二极管存在PN节电压，通常在0.7V左右，低电流是影响不明显，但流过大电流时，如流过1A电流其会产生0.7W的功耗，0.7W的功耗发热对元件本身及周边元件的可靠性是个非常大的考验。 可见二极管防反接最大问题是管压降，越低损耗
用Python给Verilog设计自仿进阶：FPGA仿真如何极致压榨CPU
对于许多FPGA/IC工程师而言，设计实现游刃有余，验证仿真却常成短板——传统验证方法面临两难困局：学习UVM需投入大量时间成本，而纯Verilog自仿又会陷入重复造轮子的低效循环。以通信协议仿真为例，仅报文解析就需要重写整套解析逻辑，相当于用Verilog再实现一次协议栈，耗时费力。此时，Python的生态优势便锋芒尽显。其丰富的字符串处理库可直接解析报文，配合Cocotb框架，仅需少量Pyth
CameraLink方案为什么都在上"国产RK3588+FPGA"王炸组合
在高端机器视觉领域，CameraLink接口一直代表着高速与可靠。然而，在RK3588问世之前，高性能的CameraLink视频采集处理方案长期被基于进口DSP+FPGA的架构所垄断。近年来，随着各行业对自主可控与国产化替代的需求日益迫切，市场亟需一颗强大的“中国芯”来打破这一局面。 RK3588一经推出，立即火爆工业自动化、能源电力、安防、通信等行业！得益于8核（4核A76 + 4核A55）、
RK3588 + 国产FPGA，CameraLink视频采集轻松搞定
在CameraLink等专业视频接口领域，技术长期由海外巨头主导，基于进口DSP和FPGA的架构使我国产业面临核心技术和供应链的双重制约。随着国产化要求从政策引导转为硬性标准，市场需要高性能的国产替代方案。RK3588等国产芯片凭借出色性能，成为推动CameraLink技术自主化的重要选择。 RK3588一经推出，立即火爆工业自动化、能源电力、安防、通信等行业！得益于8核（4核A76 + 4核A
一个简单实用的防短路电路
在电源供电设计中，经常出现外接负载电路短路引起供电电路损坏和负载损坏。 因此防短路电路在电路设计中起着保护电路的重要作用。 这次介绍一个简单实用的防短路电路，在实际项目电路设计中可以作为参考。 如图所示：用1个NPN，1个PNP，6个电阻和1个光耦。 当Ui接上电源，晶体管Q2基极电压大于发射集电压，Q2导通；从而Q1基极电压小于发射集电压，Q1导通，Uo=Ui，光耦EL357的1脚和2脚之间压
图文学习PWM，怎么输出直流信号？！
原文整理自《运放秘籍》第三部信号电路与系统新说 PWM是脉冲宽度调制的意思，是一个周期内的高电平时间与周期时间之比，图3-9 所示，它与傅里叶变换有不解之缘。 图3-9 PWM波形 话不多说，直接看1V 1KHz的方波，占空比从10%-90%的波形，见图3-10 ，左边是时域波形，右边是频域波形，周期方波也是由无数个正弦波叠加而成的，我们可以得到几个重要信息： 1)第二行可以看到占空比50%的
ISE14.7安装教程（转）
ISE是Xilinx旗下的FPGA设计套件，界面人性化，操作相对简洁，虽然更新到14.7版本后不再更了，但是还是受很多初学者的喜爱，而且对于一些板子的也只有ISE才能支持。下面附上下载链接和安装教程。 ISE14.7**可在百度云中下载链接：** 原文链接： 在软件安装之前，得准备好软件安装包，可从Xilinx官网上下载： 下载好的软件如下所示： 接下来开始安装ISE14.7软件：
用Cadence Virtuoso IC617仿真工艺库参数
本文将会描述，如何通过V-I特性曲线得出SMIC 0.18um工艺库的工艺参数。 N-MOS的测量 提取数据 上一篇文章已经得到了在不同的vgs下的vds参数曲线。原理图如下。W为220um，L为180um，后面会用到。 为了更精确得到数据，这里改变一下扫描范围，vds范围改为0-2V，vgs范围改为0.6-1.2V，步长设置为0.2V，得出结果如下图。 选择Marker菜单中的Create
BLDC电路中A、B、C相线各自下拉一个几十k电阻的目的是？
在 BLDC 驱动电路里，A/B/C 三相相节点对地接 几十k 下拉电阻，是无感方波控制里最经典、最必要的设计，核心目的只有一个：给反电动势（BEMF）过零检测提供稳定电位基准，同时兼顾安全与抗干扰。 一、核心目的：解决无感控制的「相端浮空」问题（最关键） 无感 BLDC 靠检测三相反电动势过零点判断转子位置，而： 电机静止、低速、上下桥 MOS 全关断时，三相相端是完全浮空的高阻态 浮空相端
看图说话，单频正弦信号与方波信号傅里叶变换是什么样子
原文来自《运放秘籍》第三部 信号电路与系统新说 图3-1 是10v@10Hz的单频正弦信号10sin(2π10t)的时域波形和频域波形，示波器显示的是时域波形，是一个标准的正弦信号。而从频域上看，是一根谱线在10Hz位置的幅值是10V的信号，时域和频域描述的信息是一样的。 图3-1 单频正弦信号与FFT 图3-2 是10V@10Hz的方波信号时域波形和频域波形，示波器显示的是时域波形，是一个标
我用OpenClaw+全开源EDA工具+开源IP，做了一颗SoC
OpenClaw帮我做了件我一直想做的事情。 一直想串一下基于全开源EDA flow的芯片设计流程，但其中有大量的工具的安装和工具flows的使用，需要耗费大量的精力，OpenClaw用了一天时间帮我串了整个流程。 🎯设计目标 基于 PicoSoC 架构的增强版 RISC-V SoC 集成多种常用外设 (UART, GPIO, I2C, PWM, Timer, SPI) 适用于嵌入式控制和物联网
